PP 1065/27 Rapport technique 3: Transistors, Logique DCTL et TTL, synchronisation, 1965.01.01-1966.12.31 (Dossier)

Contexte de plan d'archivage


Zone d'identification

Cote:PP 1065/27
Cotes anciennes:27
Titre:Rapport technique 3: Transistors, Logique DCTL et TTL, synchronisation
Dates:1965-1966
Période de création:01/01/1965 - 31/12/1966
Niveau:Dossier
Importance matérielle:1 classeur

Zone du contenu et de la structure

Contenu:- Table des matières.
- Publications Electronique et microtechnique de la Chaire d'électronique par Roger Dessoulavy 1964.
- Caractéristiques des transistors au Si.
- Modèle non linéaire du transistor NPN (Ebers + Moll): introduction théorique.
- Modèle non linéaire du transistor NPN (Ebers + Moll): résumé et mesure des paramètres.
- Transistor Metal Oxide Semiconductor (MOS): théorie.
- Transistor Metal Oxide Semiconductor (MOS): résumé du modèle non linéaire.
- Diviseur de fréquence en anneau: généralités.
- Diviseurs DCTL et DCTL mod type 1: mesures.
- Diviseur Transistor-Transistor Logic (TTL) et DCTL+TTL Direct-coupled transistor logic (DCTL) types 1 et 2: théorie.
- Diviseur Transistor-Transistor Logic (TTL) et DCTL+TTL Direct-coupled transistor logic (DCTL) types 1 et 2: mesures.
- Rapport intermédiaire interne: mesure dynamique des diviseurs de fréquence en anneau.
- Calcul statique de la logique Direct-coupled transistor logic (DCTL) modifiée.
- Calcul statique de la logique Transistor-Transistor Logic (TTL).
- Mesure des paramètres pour le calcul Direct-coupled transistor logic (DCTL) mod. et Transistor-Transistor Logic (TTL) corrélations avec le modèle d'Ebers + Moll.
- Rapport final.
- Article AGEN.
- Résumés MVA et MVM, calcul MVA.
- MVM.
- Divers: CEH, oscillateurs synchronisés et autres oscillateurs.

Zone des conditions d'accès et d'utilisation

Règles d'accès:Libre.
Langue:Anglais; Français
 

URL vers cette unité de description

URL:https://davel.vd.ch/detail.aspx?ID=923026
 

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